规范
38697并行加减法或训练器是一个现成的数字电子实验训练器。本产品专门为学生理解4位和8位二进制数的并行二进制加减法的概念而设计。
并行加法器是一种组合逻辑电路，它有各种寄存器来输入数据，从而产生输出。正因为如此，输入位同时被应用，并且和几乎立即出现在输出。并行减法器电路的工作原理与此类似，只要输入被应用，差值就会出现。
该产品具有逻辑开关与led逻辑高和低输入设施。
对象
并行加法器是一种组合逻辑电路，它有各种寄存器来输入数据，从而产生输出。正因为如此，输入位同时被应用，并且和几乎立即出现在输出。并行减法器电路的工作原理与此类似，只要输入被应用，差值就会出现。
该产品具有逻辑开关与led逻辑高和低输入设施。
对象
- 研究4位二进制加减法运算
- 研究8位二进制加减法运算
特性
- 4位/8位二进制加减法
- 易于在加减模式之间切换
- led 6/视觉显示输入输出和执行逻辑
技术规范
- 直流电源:5v DC
- 逻辑水平
- 5v:高(逻辑1)
- 0V:低(逻辑0)
- LED指示:当逻辑高或“1”状态时，LED将亮;当逻辑低或“0”状态时，LED将灭
- 重量:1公斤(约)
- 尺寸(mm): W340 X H125 X D210
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